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9
LTC4212
4212f
U
PI FU CTIO S

+
SLOW
COMP
50mV
150mV
0.2V
COMP7
M3
18礢
GLITCH FILTER
UVLO

+
FAST
COMP
500ns
DELAY
BG
V
REF
=
1.236V
0.2V
CB
TRIPS
OR UVLO
ON LOW
>10祍
START-UP
CURRENT
REGULATOR
GATE
CHARGING
200礎
10礎
CB TRIPS
V
REF
10礎
7
GATE
8
SENSE
9
V
CC
CHARGE
PUMP
Z1
V
Z
 (TYP) = 12V
M2
GND
5
FAULT
10

+
4212 BD

+

+
COMP3
t
TIMER
0.2V
V
REF
COMP4
NORMAL
TIMER
2
ON
1
2礎
M6
V
CC
M5
COMP6
Z2
V
Z
 (TYP) = 28V
V
CC
1.316V
0.455V
1.5祍
DELAY
V
REF
4    PGF
+
COMP5
M12
M9
M8
3    PGT
+
COMP9
M1
M10
5礎
5礎
5礎
V
REF
0.65V
0.95V
DISABLE
GLITCH
FILTER
VALID
GLITCH
DISABLE
TIMER
6    PGI

COMP8
+

+

COMP2
COMP1
LOGIC
10祍
120祍
200礎
GATE
PULLDOWN
RESET
ECB
0.95V
0.65V
BLOCK DIAGRA
FAULT (Pin 10): Open Drain FAULT Output or External
FAULT Input. If the FAST COMP, SLOW COMP or the
power good circuit trips the ECB, the FAULT pin is latched
low. The FAULT pin is an open drain output and is typically
connected by a 10k pull-up resistor to V
CC
. An external
circuit can also trip the ECB by driving FAULT below
1.236V (typical).
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